Advanced HDL Synthesis and SOC Prototyping: RTL Design Using Verilog
Vaibbhav Taraate
- 出版商: Springer
- 出版日期: 2019-01-18
- 售價: $3,690
- 貴賓價: 9.8 折 $3,616
- 語言: 英文
- 頁數: 332
- ISBN: 9811087776
- ISBN-13: 9789811087776
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相關分類:
Verilog
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其他版本:
Advanced HDL Synthesis and SOC Prototyping: RTL Design Using Verilog (Hardcover)
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